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      Colloquio per FPGA Design Engineer

      22 giu 2017
      Dipendente anonimo
      Arlington Heights, IL

      Altre recensioni di colloqui per FPGA Design Engineer presso Nokia

      Colloquio per FPGA Design Engineer

      19 set 2023
      Dipendente anonimo
      Bengaluru
      Offerta accettata
      Esperienza positiva
      Offerta accettata
      Esperienza positiva
      Colloquio nella media

      Candidatura

      Ho presentato la mia candidatura tramite un selezionatore. Ho sostenuto un colloquio presso Nokia (Arlington Heights, IL) nel mese di set 2013

      Colloquio

      The interview was two days. First day I met with hiring managers . The conversation was mostly about my previous experience. They also gave me a bit of their background , what is the project and what they would like to achieve.

      Domande di colloquio [1]

      Domanda 1

      mostly about previous experience and some technical questions like race condition and timing analysis
      1 risposta
      Colloquio nella media

      Candidatura

      Ho presentato la mia candidatura tramite l'università. Ho sostenuto un colloquio presso Nokia (Bengaluru) nel mese di set 2023

      Colloquio

      I have attended through college campus. First round was written exam and pattern was aptitude ,English , reasoning ,Linux commands, programming code. After shortlisting written exam within two to three days interview will be schedule. My interview was lasted 1hr. Be strong in resume and Strong in Verilog . Basic knowledge of digital electronics.

      Domande di colloquio [1]

      Domanda 1

      • Tell me about yourself • Rate yourself in Verilog, SV, UVM • Verilog code in generating clock pulse high in first 3 clock pulses and low in rest of clock pulses and again clock pulse should be high on 10th to 13th. This cycle should repeat. (10 min) • FSM 1011 overlap and explain that • Mealy and moore machine. • Project (communication protocol, fpga projects, ASIC project) • Setup and hold time • What is metastability • How to minimize the violation • Most priority violation setup or hold • General question • If you giving the opportunity in fpga or dsp you will ready to work • Tell me about NOKIA
      Rispondi alla domanda