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      Colloquio per Logic Design Engineer Trainee

      15 set 2018
      Candidato anonimo a colloquio
      Banjara Hills
      Nessuna offerta
      Esperienza positiva
      Colloquio difficile

      Candidatura

      Ho presentato la mia candidatura tramite l'università. La procedura ha richiesto 3 giorni. Ho sostenuto un colloquio presso VEDA IIT (Banjara Hills) nel mese di set 2018

      Colloquio

      Total Selection process comprises of 4 parts Round 1. Online Test, which includes Basic Electronics,Aptitude note: C language is not asked in first round Round2: It comprises of 4 parts(Total 70M) 1. Digital Electronics(20M) Logical questions will be asked, designing of circuits will be asked, all the questions asked may be related to practical knowledge, Every concept is to be revised thoroughly. 2. Micro Processor(10M), 8086 micrprocessor is asked, basic questions-5M, moderate questions-3M, advanced questions-2M 3. Aptitude(20M), basic-8M. moderate-5M, advaced-7M 4. C Language(20M), basic level is required to get good marks in c language Round3: three seperate interviews for Digital, Aptitude, C Language note: microprocessors won't be asked in third round Round4: HR, asks about yur personal profile, company director will be interviewing personally with everyone. Note: Preparation of GATE level is enough and Designing of circuits plays a major role in your selection process

      Domande di colloquio [4]

      Domanda 1

      Design a combinational circuit that detects the number of overlapping 111 when a byte is passed serially?
      Rispondi alla domanda

      Domanda 2

      Design a full adder using only a special gate F= (not A)B+C Note: Do not use any type of gates except the special gate, we should not even use NOT gate while designing
      1 risposta

      Domanda 3

      Questions on pointers,strings,unions in C language
      Rispondi alla domanda

      Domanda 4

      Question on Hexademial Multiplication
      Rispondi alla domanda
      6