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      Colloquio per ASIC Design Engineer

      20 ago 2024
      Candidato anonimo a colloquio
      Austin, TX
      Nessuna offerta
      Esperienza positiva
      Colloquio difficile

      Candidatura

      Ho presentato la mia candidatura online. Ho sostenuto un colloquio presso Meta (Austin, TX) nel mese di ago 2024

      Colloquio

      Phone screen with one interviewer. Three coding questions. Next step is onsite/virtual interviews with four different engineers. Chat to introduce yourself for three minutes. Opportunity for questions at the end.

      Domande di colloquio [1]

      Domanda 1

      Write verilog code for implementing a NAND gate using a MUX
      Rispondi alla domanda

      Altre recensioni di colloqui per ASIC Design Engineer presso Meta

      Colloquio per ASIC Design Engineer

      20 feb 2026
      Candidato anonimo a colloquio
      Bengaluru
      Nessuna offerta
      Esperienza positiva
      Colloquio nella media

      Candidatura

      Ho presentato la mia candidatura tramite un selezionatore. Ho sostenuto un colloquio presso Meta (Bengaluru) nel mese di gen 2026

      Colloquio

      First the HR will contact you by email for choosing the Screening Interview dates and Screening Interview will be done. After that multiple round of interviews. They expect you to know the basics

      Domande di colloquio [1]

      Domanda 1

      The asked to write a RTL code for FSM and then about the tools used.
      Rispondi alla domanda

      Colloquio per ASIC Design Engineer

      12 feb 2024
      Candidato anonimo a colloquio
      Nessuna offerta
      Esperienza positiva
      Colloquio facile

      Candidatura

      Ho presentato la mia candidatura online. Ho sostenuto un colloquio presso Meta

      Colloquio

      The interview was easy and conducted in a relaxed manner. The interviewer was patient and kind. It was a good experience overall. This was a technical interview after the initial screening.

      Domande di colloquio [1]

      Domanda 1

      One hot encoding, FSM divide by 3, Verilog coding.
      Rispondi alla domanda
      1

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